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https://solvnetplus.synopsys.com/s/article/SpyGlass-lint-for-Japanese
https://solvnetplus.synopsys.com/s/article/SpyGlass-CDC-Jump-Start-for-Japanese
https://solvnetplus.synopsys.com/s/article/VC-SpyGlass-CDC-Jump-Start-for-Japanese
https://solvnetplus.synopsys.com/s/article/VCS-Basic-seminar-for-Japanese
https://solvnetplus.synopsys.com/s/article/Verdi-Jump-Start-for-japanse
https://solvnetplus.synopsys.com/s/article/VC-Formal-How-To-Video-library-in-Japanese
https://solvnetplus.synopsys.com/s/article/UVM-1-1-Basic-seminar-in-Japanese-for-VC-VIP-Users
設計の大規模化、複雑化にともない、クロック間をまたぐ非同期回路の設計に起因する不具合のリスクが高まっています。
そうしたCDC(Clock Domain Crossing)の問題に対処する為には、専用の静的解析ツールによる検証が必要です。
本ウェビナーでは、非同期設計の静的解析で重要となるポイントの基礎を解説し、あわせてCDC解析ツールVC SpyGlass CDCをご紹介します。
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講師:小宮 健 (日本シノプシス ベリフィケーション・グループ)
デバッグ作業は、技術者個人の経験に依存することが多く、どのような場面で、どの機能をいかに効果的に使うかによって問題解決までの時間が大きく左右されます。Verdiは、技術者個人の経験に基づく作業を、いかに機能として使い易く取り込むかという点に着目して開発されました。
不定信号の効率的なデバッグ方法、パフォーマンスに関連する機能、Verdiの Add-ons機能を全て利用することができるVerdi Ultraの概要をご紹介します。
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講師:垂水 裕司 (日本シノプシス ベリフィケーション・グループ)
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