5G 通过引入载波聚合、大规模天线技术（massive MIMO）以及利用毫米波（mmWave）频谱范围的高级调制和高带宽信道提高吞吐量，推动移动和汽车应用的速度、带宽和数据吞吐量大幅提升。这一现状大幅增加了基带、基础架构和应用处理器技术的复杂程度，形成了对新型创新 IP 的需求，以期解决这一复杂性问题。 Synopsys 的 DesignWare® IP 产品组合提供了可靠的解决方案，从高速模拟前端到先进 FinFET 技术和处理解决方案中采用的久经验证的接口 IP，可满足前沿的 5G 芯片组设计的需求。
- 设计与验证
- 产品
- 解决方案
- 资源
- 服务
- 社区
- 培训
< 设计与验证
设计与验证
< 产品
< 产品
< 产品
< 产品
< 解决方案
< 解决方案
< 解决方案
Optical Design Solutions
Lighting Simulation Software
Optical Design Software
Automotive Lighting Design Software
工程服务
< 解决方案
< 解决方案
Photonic Solutions
RSoft Photonic Device Tools
Photonic System Tools
PIC Design Software
OptoCompiler
< 设计与验证
< 服务
System Design Solutions
SoC Design
Functional Safety Services
Arm 核硬化与优化处理
方法咨询 & 流程 部署
物理设计&帮助
托管协作服务
< 设计与验证
< 社区
社区
社区概况
< 社区
< 设计与验证
培训
训练与教学
< IP核
IP核
< 产品
< 产品
< 产品
模拟 IP
数据转换器
< 产品
< 产品
< 产品
< IP核
技术通报
< IP核
成功案例
< IP核
新闻
< 资源
< 软件安全
软件安全
< 工具与服务
< 培训
< 培训
产品课程
< 培训
Community
< 资源
博客
< 软件安全
客户
< 软件安全
合作伙伴
< 软件安全
Blog
< 关于我们
关于我们
< 关于我们
关于我们
关于我们
< 关于我们
社区
社区
< 关于我们
投资者关系
投资者关系
< 新闻中心
< 关于我们
新闻中心
新闻中心
< 关于我们
资源
资源
< 招贤纳士
< 关于我们
招贤纳士
招贤纳士
5G 移动专用 DesignWare IP
解决 5G 的复杂性和速度问题
复杂基带处理
经过优化的高效处理器可增加每个周期完成的工作量，从而降低功耗
- ARC HSxD：CPU + DSP 组合架构和多核控制运行；高效连接硬件加速器
- ASIP Designer：可编程的任务优化型芯核/加速器。功耗极低、尺寸极小、计算吞吐量高
- ARC EV6x：具有 ISA，优化了通信算法和机器学习性能的宽 SIMD/VLIW 处理器
高速 AFE
模拟前端以极低的功耗提供千兆赫级信道带宽支持。模块化 5G AFE 支持：
- 不同的 MIMO 排列
- 处理超大的 5G 信道和载波聚合
- 直接射频转换实现 RFIC 简化
- 集成到 SoC 中实现更低功耗和 BOM 成本
- 拥有处理高 QAM 要求的高性能
- 300 多种移动和无线设计
高性能、可信接口 IP
提供高性能 5G 设计所需的 22-nm 到 7-nm 规格
- MIPI CSI-2、DSI 和 M-PHY 提供高速串行接口，连接应用/图像处理器和摄像头传感器
- LPPDR5/4/4X IP 实现多种能够缩短退出延迟的低功耗状态
- PCI Express 5.0/4.0 IP 为芯片到芯片通信提供高吞吐量
- 多协议 PHY 为 PCIe、CCIX、以太网等接口提供高质量的信号完整性和先进的电源管理功能
带有硬件信任根的安全 IP
在可靠的环境中完成安全协议加速：
- tRoot HSM 提供了一块“安全飞地”(Enclave)，用于处理 SoC 的敏感数据和操作
- 安全协议加速器 (SPAcc) 支持加密和身份验证
- 高性能 AES-XTS 用于静止数据加密/解密
