设计实现和签核 

功能全面的布局布线方案 

半导体的物理效应正变得越来越具有相互关联性。 每个设计决定可能带来意料之外的结果。 工程师们不能再以手工的方式来平衡各种效应,不仅仅是线电容的老问题,还诸如漏电流,感应噪声或者电压降。 制造工艺和环境的变动性可以使芯片失效或者失去经济意义。 市场力量正在要求以越来越低的价格创造更高的销量。 投资人士正对风险丧失兴趣,而更关注可预见的成功。 设计人员必须在价格和性能上走钢丝,以实现其按时将产品推向市场的目标。

  • 工具
 

DC Explorer
早期 RTL 探索可加快综合及布局布线 &
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DC Ultra
与物理结果相一致的同类中最好的时序、面积和功耗结果
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Design Compiler Graphical
扩展拓扑技术来预测并缓解布线拥塞
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Power Compiler
提供功率综合和优化的全面解决方案
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DFTMAX Ultra
结合最高测试质量和最低测试成本的压缩技术
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DFTMAX
具成本效益的深亚微米测试自适应扫描压缩
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DFTMAX LogicBIST
LogicBIST: 基于逻辑综合的系统内建自测试
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TetraMAX ATPG
用于高质量测试的自动测试向量生成和诊断工具
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TetraMAX II ATPG
下一代ATPG和诊断解决方案
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DesignWare IP
借助高质量 IP,降低风险并加快上市时间


Formality
全面、快速且直观的等效性检查
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Synphony C Compiler
高层次综合加速图像处理知识产权模块(IP)的设计
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GenSys
自动化SoC组装及易于使用的RTL重构


SpyGlass DFT ADV


IC Compiler II
一套为所有工艺节点中的设计提供10倍更快吞吐量的完整的布局布线系统



IC Compiler
IC Compiler 是提供完整设计解决方案的 Synopsys Galaxy™ 设计平台的一个必要组成部分
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Custom Compiler
视觉辅助自动化定制版图
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Laker 定制设计
定制 IC 设计和版图解决方案


Laker 平板显示
平板显示编辑器


PrimeTime
金牌时序签核,包括 STA、SSTA、SI 和功耗分析
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NanoTime
用于定制设计的高性能晶体管级 STA
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PrimeRail
供布局布线工程师用于 In-Design 电源网格分析
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StarRC
业界领先的用于数字和定制化设计的寄生参数提取
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StarRC Custom
统一的金牌标准参数提取工具,包括 Rapid3D 现场快速求解器
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SiliconSmart
先进的单元特性表征
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Liberty NCX
参考库特性表征系统
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IC Validator
包含可与 IC Compiler 及 IC Compiler II 配合实现 In-Design功能的签核DRC/LVS


Synplify Pro
FPGA 逻辑综合


Synplify Premier
先进 FPGA 和基于 FPGA 的原型的快速实现


Identify RTL 调试器
硬件操作中提供类似仿真器的可视性


Synphony Model Compiler
为数字信号处理算法提供快速、高效的ASIC & FPGA硬件开发



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