DesignWare IP 原型设计套件 

加速 IP 原型设计及集成 

DesignWare® IP 原型设计套件提供必要的软件和硬件,以减少客户在 IP 原型设计和集成所花费的精力,并让设计人员能够立即开始在 SoC 中实现 IP。套件以完整、开箱即用的参考设计为主,包含经验证的 IP 配置和必要的 SoC 集成逻辑,如时钟、复位、功耗管理以及针对特定 IP 协议的测试逻辑,并在基于 FPGA 的 Synopsys HAPS®-DX 原型设计系统中实现。IP 原型设计套件包括运行 Linux 的基于 DesignWare ARC® 32 位处理器的软件开发平台或通过 PCI Express® 与 PC 的连接。DesignWare 混合 IP 原型设计套件包括一个用于 ARM®v8 big.LITTLE™ 处理基础平台的 Virtualizer® 开发套件。所有套件均包括参考驱动程序、SoC 集成逻辑和应用示例。

凭借经验证的 IP 参考设计,设计人员的工作可立刻获得成效,有助于加快将 IP 集成到目标 SoC 中,优化 IP 配置,并基于真实 I/O 和硬件开发驱动和应用软件。设计人员可以根据目标应用,通过一个快速迭代流程来修改标准的 IP 配置,该流程环境包括 Synopsys 的 coreConsultant IP 配置工具、Synopsys 的 ProtoCompiler DX 综合和调试工具以及编译脚本。

对于硬件工程师,IP 原型设计套件提供了一种经过验证的 IP 配置,其能够针对目标应用轻松修改,以达到最佳的设计权衡。对于软件开发人员,IP 原型设计套件能够作为经过验证的目标,用于早期软件开发、启动、调试和测试。

DesignWare IP 原型设计套件
DesignWare IP 原型设计套件包括:
  • 带有预配置 IP 和 SoC 集成逻辑的基于 FPGA 的 Synopsys HAPS-DX 原型设计系统
  • PHY 子板
  • 仿真测试平台
  • 运行 Linux® 的基于 DesignWare ARC 的软件开发平台或 通过 PCI Express 与 PC 的连接或 Virtualizer 开发套件
  • 参考驱动软件
  • 应用示例

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下载混合 IP 原型设计套件数据手册

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