Galaxy 设计平台 

加快先进集成电路设计的创新,包括 16nm 

Galaxy™ 设计平台是一个适用于基于标准单元的和定制集成电路实现的全面的解决方案。Galaxy 接受采用行业标准格式的设计意图并生成一个采用 GDSII 格式的可用于生产的集成电路设计。Galaxy RTL物理实现产品通过在速度、面积、功耗、可测性和良率之间进行智能权衡来同时平衡各种设计约束。Galaxy 签核引擎可以精确模拟复杂的物理相互作用以确保信号和电源的完整性。寄生参数提取和时序的一致算法可产生具有相关性的结果。 Galaxy™ 设计平台提供一整套工具,在全球范围内进行部署,目标锁定已建立的工艺节点下的设计和 20nm 及以下的新兴工艺节点下的 FinFET 设计

 

DC Explorer
早期 RTL 探索加快综合及布局布线
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DC Ultra
与物理结果相一致的同类中最好的时序、面积和功耗结果质量
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Design Compiler Graphical
扩展拓扑技术来预测并缓解布线拥塞
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Power Compiler
提供低功耗综合和优化的全面解决方案
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DFTMAX
自适应扫描压缩应用于具成本效益的深亚微米测试
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TetraMAX ATPG
用于高质量测试的自动测试向量生成和诊断工具
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TetraMAX II ATPG
下一代ATPG和诊断解决方案
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DesignWare IP
借助高质量 IP,降低风险并加快上市时间


Formality
用于对 DC Ultra 综合得到的设计作等价性检查
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GenSys
RTL重组和设计组装
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SpyGlass DFT
RTL缺陷覆盖率分析和可测性设计的规则检查


IC Compiler II
将生产能力提高十倍的网表至 GDSII 布局布线系统
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IC Compiler
用于已建立的和新兴的工艺节点的功能全面的布局布线系统
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Custom Compiler
视觉辅助自动化定制版图
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Laker 定制设计
定制 IC 设计和版图解决方案


Laker 平板显示
平板显示编辑器


PrimeTime
黄金级时序签核解决方案及环境
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NanoTime
适用于定制设计的晶体管级 STA
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StarRC
寄生参数提取
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StarRC Custom
统一的行业标准参数提取工具,包括 Rapid3D 快速场解析器
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PrimeRail
供布局布线工程师使用的 In-Design 电源网格分析
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SiliconSmart
先进的单元特性表征
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Liberty NCX
复合电流源建模和库交付系统
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IC Validator
针对 45 nm 及以下工艺节点的 In-Design 物理验证解决方案
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基本上所有经逻辑综合得到的设计都采用 SDC,而许多 EDA 公司都拥有可以读取和处理 SDC 的翻译器。

主要优点
  • 经过直至 16nm 工艺节点的产品化验证
  • 在速度、面积、功耗、可测性和良率之间实现最佳权衡
  • 行业标准的签核时序和参数提取
  • 针对工艺库、服务和 IP 的无以伦比的第三方支持
  • 提供了通向最佳结果的最快途径

设计挑战
半导体的物理效应正变得越来越具有相互关联性。每个设计决定可能带来意料之外的结果。工程师们不能再以手工的方式来平衡各种效应,不仅仅是线电容的老问题,还诸如漏电流,感应噪声或者电压降。制造工艺和环境的变动性可以使芯片失效或者失去经济意义。市场力量正在要求以越来越低的价格创造更高的销量。投资人士正对风险丧失兴趣,而更关注可预见的成功。设计人员必须在价格和性能上走钢丝,以实现其按时将产品推向市场的目标。

摩尔定律的指数增长促进了对其产生的特有问题的创造性解决方案。计算能力的进步与创新算法的结合使 Galaxy 设计平台能够执行两个基本功能:
  1. 精确模拟物理效应以保证时序
  2. 同时评估设计目标之间的权衡

对噪声和功耗等物理作用的精确建模使得 Galaxy 平台的先进算法能够推动可实现的性能极限并最小化悲观裕量的消耗。额外的性能就像是存在银行中的钱。并发优化引擎花费这些储蓄以最小化功耗、减少面积、降低测试成本或提高良率。所有这些都因为节省了解决意外后果所需的时间和迭代,从而提高了生产率。

Galaxy 平台让设计人员能够专注于他们最擅长的工作——设计!



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