Fusion Compiler: 新時代のRTL-to-GDSIIソリューション

Synopsys, Inc.
Design Group
Product Marketing
Sr. Director　 Sanjay Bali

Fusion Compilerは、飛躍的なデザイン収束性と、フルフローのデジタル・インプリメンテーションを実現する業界初のRTL-to-GDSIIソリューションです。
Fusion Compilerは、高いキャパシティを持つ革新的な論理合成テクノロジと、業界をリードするIC Compiler IIの配置配線テクノロジを単一のデータモデル上で融合することにより、予測性を高めつつ結果品質を新しい次元に引き上げ、高性能なデジタルIP、サブシステム、大規模SoCなど業界最先端のデザインが直面する設計課題を解決します。
本セッションでは、最高品質なPPAを達成かつ設計期間を短縮するため、Fusion Compilerが採用している高いスケーラビリティを実現する単一データモデル、新たに採用/搭載した先進の最適化テクノロジなどをご紹介いたします。あわせて、この新時代のプロダクトをお客様が次世代製品の開発でどのように活用されているのか、という点についてご紹介いたします。

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次世代RTL-to-GDSIIソリューション Fusion Compiler活用事例

Fusion Technologyを用いた5nmテストチップ開発への挑戦

株式会社ソシオネクスト
オートモーティブ＆インダストリアルビジネスグループ LSI開発統括部 先行技術開発部
課長代理　荒川 利夫 様

微細化の進展は、SoC上へのアプリケーションの実装容量の拡大と、低電力化をもたらす一方で、そこからデバイス実装では、設計的工程間での乖離とバラツキに対する統合的なソリューションがより一層重要となります。
ソシオネクストでは、7nmに至る豊富な設計経験をもとに、Fusion Compilerを中核とし、IC Validator、StarRC、PrimeTime等各種サインオフツールとも融合した、シノプシス社の様々なFusion Technologyを5nmで初めて実設計のフローに取り入れたことで、特有の複雑なデザイン・ルールを考慮しながら、PPAを確保して、5nmテストチップ開発を成功することができました。
本セッションでは、これらの適用事例と、さらなる設計生産性向上に向けた弊社の取り組みについてもご紹介します。

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真の統合設計Fusion Compiler - Unified Physical Synthesis活用事例　～世界に先駆けフルチップ製品適用で低消費電力化を実現～

東芝メモリ株式会社
設計技術推進部 設計技術第一担当
主務　宮武 太一 様

IoT時代の到来とSNS/クラウドサービスの普及によりモバイル/データセンター向けNANDフラッシュメモリ/SSDの需要は拡大しており、それらの製品には低消費電力化が市場より強く求められています。そのコントローラ開発においても低消費電力化は最重要課題であり、本課題を解決しつつ市場ニーズに応える製品をいかに短期間で開発しタイムリーに市場投入できるかがビジネス成功の鍵となります。その実現のため、当社では設計仕様に基づくPPAを決定しRTLからGDSIIまでの設計工程間のQoRを一貫して保持、そして決定したPPAを達成するためのシンセシス/インプリメンテーション統合設計環境の構築を目指してきました。本セッションでは、Fusion Compilerの新しいエンジンであるUPSの活用によりQoRの一貫性を実現した手法と、従来フローでは達成し得なかった低消費電力目標を達成し、短TATかつPPA最大化で設計生産性を向上させたFusion Compilerの世界初となるフルチップ製品適用事例をご紹介します。

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次世代RTL-to-GDSIIソリューション Fusion Compiler活用事例

ルネサスにおける次世代車載LSI向け超低消費電力設計技術の開発

ルネサス エレクトロニクス株式会社
IoT・インフラ事業本部 共通EDA技術開発統括部 デジタル設計技術部 インプリメンテーション技術課
櫻井 翔之 様

近年、信頼性の観点から車載製品の低消費電力化が重要になっています。ルネサスではこの課題に対して、より設計の自由度が高い合成段階から、効果的に電力を削減する設計手法を開発し次世代車載LSI R-Car/RH850に実適用しました。Fusion Compilerの特徴を活かした、合成段階でのクロックのスキューイング、大規模一括合成による階層最適化制限の緩和、冗長論理削減の3つの施策を適用することで、従来のDesign Compilerフローよりも最大37%の電力削減を達成しています。本発表では、新フローの詳細とその効果について、適用結果を交えてご紹介します。

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Fusion Compilerを核とした東芝の最新SoC設計環境Tachyonの紹介、およびテープアウト事例　-True GDS2RTL Flow-

東芝デバイス＆ストレージ株式会社
システムデバイス事業部 デジタル開発第二部 デジタルインプリメンテーション第二担当
主査　光安 政浩 様

近年の大規模/高性能SoCの開発では、高度な設計技術が不可欠になっています。特に先端ノードでは、設計初期段階から詳細な物理設計を考慮した設計手法が必要になります。東芝デバイス＆ストレージでは、シノプシス社の次世代ツール Fusion Compilerの開発初期段階から評価/フィードバックを行い、ツール改良に協力するとともに、当社設計環境：Tachyonに組込む機能をネイティブで実現しました。この協業により、いち早くFusion Compilerの利用技術を確立し、Tachyonに統合することで、先端/大規模SoC設計に於いて、設計効率化、デザイン収束性向上、低消費電力化、および高信頼性等を実現しています。本発表では、Fusion Compiler統合設計環境Tachyonをご紹介するとともに、ADAS向けSoC等のテープアウト事例の紹介を行います。

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Formality and Formality ECO 2019最新情報とロードマップ

Synopsys, Inc.
Design Group
Digital Implementation Marketing
Product Marketing Manager　Bradley Geden

本セッションでは、Formality/Formality ECOが2019年に提供する新機能と改善事項を紹介します。2019年で実装予定の主な機能(Reverse Clock Gating, Debug Strategies, Cell Reuse and Cloud Optimizations)の他、最新のロードマップもご紹介します。

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シノプシスの次世代論理合成ツール Design Compiler NXT

日本シノプシス合同会社
デザイン・グループ
シニア アプリケーション・コンサルタント　小泉 浩司

1986年の発表以来30年以上、シノプシスのDesign CompilerはDC Ultra、Design Compiler Graphicalと進化しつつ、常に論理合成のデファクト・スタンダードの地位を保ってきました。
今年2019年に発表されたDesign Compiler NXTは従来のDesign Compilerと全く同じインターフェイスを保ちながら、実行時間の短縮、タイミング・消費電力・面積最適化機能の強化、IC Compiler IIとの連携による物理最適化機能の強化、P&Rとの一致性のさらなる向上、5nmプロセス以降を見据えた的確な対応、と劇的に進化しています。
本セッションでは、新しく生まれ変わったシノプシスの論理合成ツール Design Compiler NXTを、大きく進化した点を中心に豊富な事例を含めてご紹介します。

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日本発　SDC運用状況の分析と改善提案

東芝メモリ株式会社
設計技術推進部　設計技術第一担当
グループ長　土屋 丈彦　様

東芝デバイス＆ストレージ株式会社
システムデバイス事業部　デジタル開発第二部
デジタルインプリメンテーション第二担当
主務　白井 利明　様

日本シノプシス合同会社
デザイン・グループ
シニアスタッフ・アプリケーション・エンジニア　粂田 寛治

SDCは、Synopsys社が作成した、主にタイミング仕様を定義する業界標準フォーマットとして確固たる地位を築いています。しかし、今回SDCの使用ユーザ各社でSDC運用状況に関して議論を行った所、業界標準ならでこそ発生するいくつかの課題が潜在的にあることが判明しました。本セッションでは、これら日本のユーザ各社が解決したい課題に対して、状況の分析を行い、要望/改善提案をまとめました。これにより、今後のSDC運用環境の更なる発展を目指します。システム、半導体の両ビジネスから集まった5社にて検討した内容を元に代表者が分析結果の報告と改善提案をいたします。